HBM 為什麼離不開先進封裝？TSV、CoWoS 和封裝設備的作用

HBM 不是普通 DRAM 的簡單升級，而是「多層 DRAM 堆疊 + TSV 垂直互連 + 2.5D/3D 先進封裝 + GPU/AI 加速器同封裝集成」的系統工程。AI 晶片需要在更短距離內獲得更高頻寬、更低功耗和更高封裝密度，TSV 解決垂直堆疊，CoWoS 解決邏輯晶片與 HBM 的橫向互連，封裝設備則決定良率、產能和成本。

核心要點

• HBM 的核心優勢來自堆疊 DRAM 和超寬 I/O 介面。
• TSV 是 HBM 多層 DRAM 垂直互連的關鍵。
• CoWoS 讓 GPU、ASIC 與 HBM 在同一封裝中協同工作。
• 先進封裝產能會影響 AI 晶片交付速度。
• TCB、混合鍵合和檢測設備決定 HBM 良率。
• 投資 HBM 供應鏈要同時看記憶體、封裝和設備。

HBM 為什麼不是普通 DRAM 的簡單升級？

HBM 不是把 DRAM 頻率單純拉高，而是把多層 DRAM 垂直堆疊，並透過 TSV、微凸點、中介層和先進封裝放到 GPU 或 AI ASIC 旁邊。它解決的是 AI 訓練和推理中的「記憶體頻寬牆」，所以關鍵不只是記憶體製程，而是記憶體、邏輯晶片和封裝結構能否協同工作。

AI 大模型訓練、推理、長上下文、KV cache、向量資料庫和多模態任務，都需要大量資料在計算單元與記憶體之間高速移動。普通 DDR 或 GDDR 依賴較長的外部連接，I/O 通道和功耗效率都受到限制；HBM 則透過超寬 I/O 和短距離互連，把頻寬問題從「提高頻率」轉向「增加並行通道」。

Micron 介紹其 HBM4 時提到，HBM4 採用 2048-pin bus interface，速度超過 11Gbps，單堆疊頻寬超過 2.8TB/s。Samsung 也表示，其 HBM4 可提供最高 3300GB/s 頻寬，並面向 AI 系統效率和效能擴展。這些規格說明，HBM 的核心不是單個 DRAM die 變快，而是透過堆疊結構和寬介面在有限封裝空間裡提供更高吞吐。

HBM 的系統價值來自「靠近計算」。在 AI 加速器中，GPU、ASIC、chiplet 與多顆 HBM 通常被放進同一個先進封裝內，透過 silicon interposer 或 RDL interposer 連接。TSMC 的 CoWoS-S 說明中提到，大尺寸 silicon interposer 可以容納 logic chiplets 和 HBM cubes，面向 AI 與超級計算應用。這意味著 HBM 不是獨立賣給系統廠再遠距離連接，而是直接成為 AI 晶片封裝的一部分。

HBM 越先進，封裝難度越高。HBM3E、HBM4、HBM4E 會增加 I/O 數量、堆疊層數、頻寬和功耗密度。SK hynix 在 HBM4 資料中強調，其 HBM4 將 I/O 端子從上一代的 1024 個增加到 2048 個，並採用 Advanced MR-MUF 工藝來降低量產風險。I/O 越多、堆疊越高，翹曲、散熱、鍵合精度和測試難度都會上升。

小結：HBM 的價值不只是「更快的 DRAM」，而是把記憶體頻寬、功耗和空間效率重新設計到 AI 晶片封裝內部。普通 DRAM 更多依賴晶片製程和外部連接，HBM 則依賴 TSV、微凸點、中介層、CoWoS 和先進封裝設備。你判斷 HBM 產業鏈時，不能只看 DRAM 原廠產能，還要看先進封裝能否支撐更多堆疊、更高良率、更大封裝面積和更快交付。

TSV 在 HBM 中到底起什麼作用？

TSV 是 HBM 能夠垂直堆疊的核心互連技術。它透過穿過矽片的垂直導通孔，把多層 DRAM die 連接起來，讓資料、電源和控制訊號在堆疊內部上下傳輸。沒有 TSV，HBM 很難在有限面積內實現高頻寬、低功耗和高密度堆疊。

TSV 的全稱是 Through-Silicon Via，也就是穿矽通孔。你可以把它理解為貫穿矽片的垂直「高速通道」。HBM 堆疊通常由多層 DRAM die、base die 或 logic die、微凸點、TSV、underfill 和封裝材料組成。傳統晶片更多依賴邊緣走線或封裝基板連接，路徑較長；TSV 讓訊號在矽片內部上下傳輸，路徑更短，更適合高並行度資料傳輸。

TSV 能降低功耗和延遲，是因為 HBM 不需要透過高頻窄通道來堆頻寬，而是透過大量並行 I/O 在較低時脈下傳輸資料。TSMC 在討論 HBM 與寬介面 時提到，HBM 可以在相同頻寬下用較低時脈運行，從而降低功耗。對 AI 晶片來說，這一點很關鍵，因為資料搬運本身會消耗大量能量，記憶體頻寬提升若伴隨功耗暴漲，就會抵消系統收益。

TSV 也帶來製造挑戰。它需要深孔刻蝕、絕緣層形成、銅填充、CMP 平坦化、晶圓減薄、鍵合、封裝和檢測等多道工序。任何一個 TSV 缺陷，都可能影響整顆 HBM 堆疊良率。Samsung 在商業化 HBM4 時提到，HBM4 透過 low-voltage TSV 技術和 PDN 優化提升功耗效率，並改善熱阻與散熱能力。這說明 TSV 不只是連接結構，也和供電、能效、散熱直接相關。

TSV 對 HBM 的影響可以拆成五個環節：

1. 垂直連接多層 DRAM die，形成高密度堆疊。
2. 縮短訊號路徑，降低延遲和數據搬運能耗。
3. 支援超寬 I/O 並行傳輸，提高單位封裝頻寬。
4. 提升單位面積儲存容量，適合 AI 晶片有限封裝空間。
5. 增加刻蝕、填充、減薄、鍵合和檢測的複雜度。

對供應鏈來說，TSV 把 HBM 從「記憶體晶片製造」推向「記憶體製造 + 先進封裝 + 高精度檢測」的複合工藝。記憶體原廠需要掌握 DRAM die、base die、TSV、堆疊和封裝材料之間的協同，設備廠則要解決微米級對位、缺陷檢測、應力控制和散熱材料適配。

小結:TSV 是 HBM 與普通 DRAM 最大的結構差異之一。它讓多層 DRAM 不再依賴外部走線,而是在矽片內部垂直互連,形成高頻寬、低功耗、高密度的堆疊結構。但 TSV 也顯著提高了製造和封裝難度,要求更精密的刻蝕、填充、減薄、鍵合和檢測能力。你看 HBM 產能時,必須關注 TSV 良率、堆疊層數、熱管理和封裝設備能力。

CoWoS 為什麼是 AI 晶片和 HBM 的關鍵連接平台？

CoWoS 的作用，是把 GPU、AI ASIC、chiplet 和多顆 HBM 放到同一個大封裝裡，並透過 silicon interposer 或 RDL interposer 進行高速互連。HBM 提供高頻寬記憶體，但只有透過 CoWoS 這類 2.5D 封裝，AI 晶片才能真正高效調用這些頻寬。

CoWoS 是 Chip on Wafer on Substrate 的縮寫。簡單說，邏輯晶片和 HBM 先透過 wafer-level integration 與中介層連接，再連接到底部封裝基板。中介層提供高密度、短距離、低延遲的互連路徑，讓 GPU/ASIC 能同時存取多顆 HBM 堆疊。沒有這種高密度連接平台，HBM 的高頻寬很難轉化為 AI 加速器可用的系統效能。

AI 加速器越來越依賴大尺寸 interposer，原因是邏輯晶片變大，HBM 堆疊數量增加，chiplet 組合也更複雜。TSMC 在 2025 年技術發布中表示，計劃在 2027 年量產 9.5 reticle size CoWoS，可支援整合 12 個或更多 HBM 堆疊。這意味著 AI 晶片封裝正在從「單晶片 + 少量 HBM」走向「多 chiplet + 多 HBM + 超大封裝」。

TSMC 的 CoWoS 平台包括 CoWoS-S、CoWoS-R 和 CoWoS-L。CoWoS-S 以 silicon interposer 為核心，互連密度高，常用於高效能 AI 與 HPC；CoWoS-R 使用 RDL interposer，強調更大設計彈性；CoWoS-L 結合 RDL 與 local silicon interconnect，更適合更複雜的大尺寸封裝。Nvidia Blackwell 等 AI 晶片對 CoWoS-L 的需求，也說明 AI 封裝路線正在從單一方案走向多平台並行。

CoWoS 之所以容易成為瓶頸，是因為它需要先進晶圓代工、封裝基板、中介層、HBM 供應、熱管理和高良率裝配同時配合。TrendForce 預計，2.5D 封裝嚴重短缺可能到 2027 年才會略有緩解，並提到 TSMC 計劃到 2027 年將 CoWoS 產能擴張超過 60%。這說明 AI 晶片交付不只取決於 GPU die，也取決於封裝平台能否按時擴產。

小結：HBM 提供高頻寬，但 CoWoS 決定這些頻寬能否被 AI 晶片高效使用。沒有 CoWoS 或同類 2.5D 封裝，GPU 與 HBM 之間仍會受互連密度、距離、功耗和封裝尺寸限制。你看 AI 晶片供應鏈時，CoWoS 不是後段配角，而是連接先進邏輯晶片、HBM 和系統效能的核心平台。封裝產能不足，可能直接限制 Nvidia、AMD、雲廠商 ASIC 等 AI 晶片交付。

先進封裝設備為什麼會成為 HBM 供應鏈瓶頸？

HBM 供應瓶頸不只在 DRAM 晶圓，也在 TSV、堆疊、鍵合、檢測、基板和 CoWoS 產能。先進封裝設備決定 HBM 能否以足夠良率和速度量產，包括熱壓鍵合、混合鍵合、臨時鍵合、晶圓減薄、檢測量測和封裝材料設備。設備不足或良率不穩，會直接限制 AI 晶片交付。

TCB 熱壓鍵合是 HBM 和 2.5D/3D 封裝中的關鍵工藝之一。Thermo-Compression Bonding 通過溫度、壓力和高精度對位，把 die 與 wafer、die 與 substrate 或多個晶片層連接起來。ASMPT 的 FIREBIRD TCB 面向 2D、2.5D 和 3D 異構集成，強調 ±2.0 μm placement accuracy 和低於 2 秒的處理週期，適合高性能運算和 AI 應用。

隨著 HBM 堆疊層數提高，傳統助焊劑工藝可能帶來污染、清洗和良率問題。ASMPT 進一步介紹 AOR TCB 時指出，fluxless thermocompression bonding 可以減少污染風險，改善 bonding uniformity，並加速 time-to-yield。對 HBM 來說，良率不是小問題，因為一個堆疊裡任何一層出問題，都可能影響整顆產品成本。

混合鍵合被視為下一代方向。Hybrid Bonding 透過銅對銅、氧化物對氧化物直接連接，能提升互連密度並縮小間距。Besi 的 Hybrid Bonding 平台強調潔淨度、光學對準和高密度互連，主要面向 3D 整合和先進封裝。Yole Group 預計，TCB 和 hybrid bonding 將推動後道設備市場擴張，其中 TCB 設備市場到 2030 年達到 9.36 億美元，hybrid bonding 設備市場達到 3.97 億美元。

檢測、量測和材料設備同樣關鍵。TSV、微凸點、RDL、underfill、mold、warpage 都需要嚴格檢測。Applied Materials 提到，AI 計算正受到 memory wall 約束，HBM 和 3D stacking 帶來新的 process complexity，因此需要新的 DRAM 與先進封裝系統來提升良率和生產效率。先進封裝不是一台鍵合機能解決的問題，而是一整條設備和材料鏈的協同。

小結：HBM 供應鏈瓶頸不是「記憶體廠多投片」就能解決。層數越高、I/O 越寬、封裝越大，越依賴熱壓鍵合、混合鍵合、TSV 製程、檢測量測和封裝材料。先進封裝設備決定 HBM 量產速度、良率和成本，也是 AI 晶片供應鏈中容易被忽視但非常關鍵的環節。你看 HBM 擴產時，要同時跟蹤設備訂單、交期、裝機進度、客戶驗證和良率爬坡。

HBM 供應鏈中哪些公司和環節最值得關注？

HBM 供應鏈可以分為記憶體原廠、晶圓代工與先進封裝、封裝設備、材料與基板、AI 晶片客戶五類。投資者不能只看 HBM 出貨量，還要看誰掌握堆疊技術、誰有 CoWoS 產能、誰能提供關鍵設備，以及誰能進入 Nvidia、AMD、雲廠商 ASIC 等客戶供應鏈。

記憶體原廠是第一層。SK hynix、Samsung、Micron 之間的競爭，不只是 DRAM 晶圓產能競爭，也是 HBM3E、HBM4、HBM4E 的堆疊、良率、散熱和客戶認證競爭。SK hynix 強調 Advanced MR-MUF 和 2048 I/O；Micron 強調 2048-pin bus、超過 11Gbps 和單堆疊超過 2.8TB/s；Samsung 強調最高 3300GB/s、低電壓 TSV I/O 和 PDN 優化。這些資訊說明 HBM 競爭已經進入「規格 + 封裝 + 客戶導入」階段。

晶圓代工和封裝平台是第二層。TSMC 的 CoWoS 產能會影響 Nvidia、AMD、Broadcom 以及雲端廠商自研 ASIC 的交付節奏。Samsung Foundry、Intel Foundry 和 OSAT 生態系也在佈局先進封裝，但在高端 AI 加速器領域，CoWoS 仍是核心平台之一。對投資者來說，CoWoS 擴產、interposer 面積、基板供應和封裝良率，是觀察 AI 晶片供應鏈瓶頸的重要指標。

封裝設備與材料是第三層。ASMPT、Besi、Applied Materials、KLA、Onto、DISCO、TEL 等公司並不直接銷售 HBM，但它們提供的鍵合、檢測、減薄、量測、材料處理設備，會影響 HBM 堆疊和 CoWoS 良率。Reuters 報道 Besi 一季度訂單同比增長 104.5%，並指出增長受到 hybrid bonding 技術採用推動。設備訂單往往會領先封裝產能釋放，因此也值得追蹤。

如果你關注相關股票，也要把技術路線和交易成本分開看。HBM、CoWoS 和先進封裝設備股可能因為 AI 預期而快速波動，交易前除了研究財報、訂單和估值，也需要理解實際費用結構。Biya支持美股與港股等多資產交易，Biya 美股交易佣金為 0 美元，平台費、外部機構費及其他費用以費用中心和訂單頁面展示為準；相關服務是否可用，取決於用戶所在地、身份驗證結果、平台規則及適用法律法規。

小結：HBM 供應鏈不是單一「記憶體股」邏輯，而是記憶體原廠、晶圓代工、CoWoS、封裝設備、材料和 AI 晶片客戶共同決定。你看相關股票時，應區分短期訂單、長期產能、客戶認證和設備瓶頸。HBM 越往 HBM4、HBM4E、HBM5 演進，封裝設備和 CoWoS 產能的重要性越高。真正有壁壘的環節，往往是規格升級後仍能維持良率、交付和客戶認證的公司。

投資 HBM 與先進封裝產業鏈要注意哪些風險？

HBM 和先進封裝是 AI 基礎設施的重要方向，但並不意味著相關公司都能持續受益。主要風險包括 CoWoS 擴產後供需緩和、HBM 良率不及預期、客戶認證延遲、設備訂單波動、AI 晶片需求放緩、地緣與出口限制，以及估值提前透支。

第一類風險是供給擴張讓瓶頸緩解。TSMC、OSAT、記憶體原廠和設備廠都在擴產，CoWoS、HBM 堆疊和封裝設備短缺不一定永久存在。TrendForce 對 2.5D 封裝的判斷也顯示，短缺可能到 2027 年開始緩解。若供給擴張快於 AI 晶片真實需求，相關公司的議價能力和利潤率可能從「極度緊缺」回到「結構性緊張」。

第二類風險是客戶認證和良率。HBM 不只是做出樣品，還要通過 Nvidia、AMD、ASIC 客戶的長期驗證。HBM4 的 2048 I/O、更高堆疊層數、更複雜 base die 和更大封裝面積，都可能拉長量產爬坡週期。設備公司訂單可能先反映景氣，但實際收入和利潤還要看交付、驗收和客戶擴產節奏。

第三類風險是估值和交易行為。HBM、CoWoS、封裝設備相關股票可能提前反映 AI 樂觀預期，一旦訂單增速放緩、毛利率不及預期或客戶轉向多供應商，股價波動可能加大。對普通投資者來說，技術方向正確不等於入場價格一定合理。

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小結：HBM 與先進封裝的長期方向明確，但短期投資仍要看價格、良率、產能、客戶認證和估值。先進封裝瓶頸可能帶來高景氣，也可能隨著擴產而緩解。你不能只用「AI 需求強」判斷所有 HBM 供應鏈股票，還要拆分記憶體原廠、CoWoS、設備、材料和客戶結構。只有同時具備技術壁壘、客戶認證、擴產能力和合理估值的公司，才更值得持續追蹤。

理解 HBM 與先進封裝供應鏈，有助於你跟蹤 AI 半導體和相關股票變化。如果你關注 SK hynix、Micron、Samsung、TSMC、ASMPT、Besi、Applied Materials、KLA 等先進封裝和存儲產業鏈公司，除了看技術路線、客戶認證和產能擴張，也需要關注交易成本與訂單費用。Biya 是一款全球多資產交易錢包，支持美股、港股和數字貨幣交易；你可以根據所在地、身份驗證結果和平台規則，選擇是否通過註冊賬戶或下載 App進一步了解相關服務。以上內容僅介紹公開市場信息、技術路線和費用結構，不構成投資建議。

FAQ

HBM 為什麼必須使用 TSV 技術？

HBM 必須使用 TSV，是因為多層 DRAM die 需要通過垂直通道傳輸數據、電源和控制信號。TSV 能縮短信號路徑，提高帶寬和密度，但也會增加刻蝕、填充、減薄、鍵合和良率控制難度。

CoWoS 和 HBM 是什麼關係？

CoWoS 是連接 AI 芯片和 HBM 的先進封裝平台。HBM 提供高帶寬內存，CoWoS 負責把 GPU、ASIC 與多顆 HBM 放在同一封裝中高速互連。兩者共同決定 AI 加速器的帶寬、功耗和封裝效率。

HBM4 為什麼對先進封裝要求更高？

HBM4 對先進封裝要求更高，因為 I/O 數量、帶寬、堆疊層數和功耗密度都提升。它需要更精密的 TSV、鍵合、散熱、檢測和 CoWoS 集成能力，封裝良率會直接影響量產速度和成本。

先進封裝設備股如何受益於 HBM 擴產？

先進封裝設備股可能受益於 HBM 擴產帶來的 TCB、混合鍵合、TSV 製程、檢測量測和材料設備需求。但能否真正受益，還取決於訂單兌現、客戶集中度、交付週期、驗收進度和估值水平。

HBM 供應鏈瓶頸只在 CoWoS 嗎？

HBM 供應鏈瓶頸不只在 CoWoS。CoWoS 是重要環節，但 DRAM 晶圓、TSV、堆疊、鍵合、基板、檢測、散熱和客戶認證也會影響交付。任何一個環節受限，都可能拖慢 AI 晶片出貨。

普通投資者如何跟蹤 HBM 先進封裝週期？

普通投資者可以跟蹤 HBM3E/HBM4 出貨、CoWoS 產能、封裝設備訂單、客戶認證、AI 晶片需求和公司毛利率變化。單一新聞不足以判斷週期，應結合財報、行業數據和交易風險綜合分析。